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https://www.ti.com.cn/cn/lit/ds/symlink/msp430f5529.pdf?ts1600611951477&ref_urlhttps%253A%252F%252Fwww.ti.com.cn%252Fproduct%252Fcn%252FMSP430F5529
https://www.ti.com/lit/ug/slau533d/slau533d.pdf UCA0 用了这个串口就不能用了 P2.7//UCA0CLK P3.2//UCA0…
5大优势告诉你，加入MSP合作伙伴的重要性
01
什么是MSP？
MSP全称Managed Service Provider，指管理服务提供商，适用以设备或IT基础架构为中心的服务类型，现在延伸为用户提供持续定期的主动管理，提供IT基础架构、应用程序和安全等运维和支持服务。
LinkSLA为众…
七、MSP432飞控快速二次开发入门教程
七、MSP432飞控快速二次开发入门教程
飞控代码二次开发是指利用飞控已有的姿态控制、速度控制、位置控制、SDK库、API函数、外部视觉解析等基本单元模块，针对特定赛题任务，用户自行编写代码，对项目功能进行二次开发完成对应任务。
弄懂基本…
【Xilinx】基于MPSoC的OpenAMP实现（一）
【Xilinx】基于MPSoC的OpenAMP实现（一） 一、开发环境1、开发思路2、下载官方bsp包 二、编译Linux1、配置petalinux环境变量2、创建工程3、进入目录4、设置缓存目录（重点：可离线编译，加快编译速度）5、配置u-…
Xilinx Vitis 2020.1里面运行C程序时提示找不到microblaze_0
Executables selected for download on to the following processors doesnt exist or incorrectly specified. Do you wish to ignore them and proceed? 1. microblaze_0 其实根本就不是MicroBlaze找不到，而是程序根本就没有编译出来！
仔细看一下编译…
-光纤接口硬件测试)
基于VC709构建FPGA开发学习平台(六)-光纤接口硬件测试
一、构建硬件环境
注意VC709的光纤接口的硬件排列顺序：4、3、1、2。由于FPGA程序中使用的是单lane，并将引脚映射至SPF通道1，所以将光模块插入到1口中，使用光纤法兰，将收、发对插，完成外部光纤回环。 二、测…
-光纤接口AuroraIP例化与仿真测试)
基于VC709构建FPGA开发学习平台(五)-光纤接口AuroraIP例化与仿真测试
一、 对EXAMPLE_DESIGN进行例化
前续文章分析过，对example_design提供正确的时钟和复位，其就具备了开始工作的条件，例化接口比较简单，在top.v中，顶层端口列表增加GT接口：
module top(......// GTX Serial…
![[学习笔记-FPGA]Vivado出现信号差分问题](http://pic.002.xiahunao.cn/mzlw/[学习笔记-FPGA]Vivado出现信号差分问题)
[学习笔记-FPGA]Vivado出现信号差分问题
个人笔记。
用Vivado写串口时出现了[DRC IOSTDTYPE-1] IOStandard Type: I/O port sys_clk is Single-Ended but has an IOStandard of DIFF_SSTL15 which can only support Differential报错。
解决方法：在顶层模块中调用clk IP核。
1、 双击第三步。
2、 配置…
【SRIO】6、Xilinx RapidIO核仿真与包时序分析
目录 一、软件平台与硬件平台
二、介绍
三、例子工程结构
四、SRIO核包时序分析
4.1 链路初始化与控制符号
4.2 SWRITE事务
4.3 NWRITE_R事务
4.4 NWRITE_R的响应事务
4.5 NWRITE事务
4.6 NREAD事务
4.7 NREAD响应事务
4.8 MAINTENANCE事务
4.9 DOORBELL事务与MESS…
基于VC709开发板的光纤收发的调试与实现，以及过程中遇到的问题与解决。
VC709是xilinx旗下的一款开发板，搭载了强大的Virtex-7芯片。有着丰富存储资源，时钟资源与高速接口。具体可参考xilinx官网的ug887手册，本次主要是想记录一下自己的学习过程与遇到的困难。
一、利用IBERT核实现回环测试。
具体的实现流程可参考知乎文章：在开始高速接口前，…
一文速通 IIC I2C子系统驱动 通信协议原理 硬件 时序 深度剖析
本文作为一个引入，作用是让读者理解熟知IIC协议关键内容，结合实际手册内容，深度解析协议本质，作为后续嵌入式linux驱动IIC子系统的一个铺垫。 目录
1. 硬件连接
2. IIC传输时序
2.1.写操作
2.2.读操作
2.3.I2C信号
3.IIC协议…
【正点原子FPGA连载】第三十一章基于lwip的echo server实验 摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南
第三十一章基于lwip的echo server实验
随着物联网的兴起，万物互联需要一个强大而又灵活的协议体系，TCP/IP协议得天独厚，而在嵌入式网络设备中，由于硬件资源的限制，需要特殊的实现方式。LWIP作为TCP/IP协议的一种轻量级…
-GTH的参考时钟)
基于VC709构建FPGA开发学习平台(三)-GTH的参考时钟
一、GTH使用情况
VC709的GTH主要用于三个接口： 1）PCIe X8： Bank114\115用于PCIe接口，参考时钟REFCLK由PCIe Host通过金手指提供； 2）FMC扩展：Bank117\118\119用于FMC扩展板接口，参考时钟REFCLK来自于FMC子板； 3）SFP+接口： Bank113连接四个SFP+接口，参考时钟有两个，…
探索精准时间之旅：Si5324时钟发生器配置神器
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时钟发生器Si5324配置程序
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Xilinx zc706 Si5324
作者
QQ群：852283276 微信：arm80x86 微信公众号：青儿创客基地 B站：主页 https://space.bilibili.com/208826118
参考 Si5324官网 任意频率时钟发生器Si5324配置小结 方法
芯片支持两组输入两组输出，一个输入16-17脚…
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任意频率时钟发生器Si5324配置小结
Si5324是Silicon Labs公司的一款任意频率时钟发生芯片。基于Silicon Labs的DSPLL技术，可以从任何输入频率产生无限组合的低抖动输出频率，Si53xx系列的芯片好像都是这种类似的功能。 图1. DSPLL模块图解 Si5324有很多寄存器，要正确的使用它就得…
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