本篇博客重点在于标准库函数的理解与使用，搭建一个框架便于快速开发 目录 WDG简介 IWDG IWDG特性 独立看门狗时钟 键寄存器 超时时间 IWDG代码 WWDG WWDG特性 窗口看门狗时钟 超时时间 WWDG时序 WWDG代码 IWDG和WWDG对比 WDG简介 WDG（…

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参考 获取运行中的Word对象:https://blog.csdn.net/seker_2006/article/details/1335702 PPT在CreateDispatch _T("Word.Application")可以直接使用获取当前文档，word和excel不能获取当前激活文档，需要采用以下两种方式。 1.使用AccessibleOb…

输入文件卡片综述 本章给出输入卡一览表，并指出什么时候需要这些卡。对表中有关符号说明如下： N表示中子问题；G表示光子问题；NG表示中子/光子耦合问题；R表示对指定的MODE要求此卡；O表示根据用户需要选择使…

1.前言 STM32 程序卡着不动，可能是发生了硬件错误，进入了HardFault_Handler处理程序中。 2.问题描述 调试STM32程序时，遇到一个很古怪的问题。程序本应输出CRC的内容。结果没有任何打印输出。通过缩小问题范围，定位应该是hexS…

1 简介 FPGA对于外部的时钟以及数据的延时信息是不知道的，在低速时钟且时钟发射沿在数据正中心的时候，一般可以不做约束来直接使用。但是到了高速时钟或者双沿采样或者发射沿和数据对齐的情况下，这时候就需要告诉VIVADO外部的时钟与数据情况来…

1.明白HAL_Delay()是基于syssTick位于cortex内核里的一个滴答定时器，sysTick是一个24位的递减计数器，减到0后根据sysTick的重装载寄存器的值，再次递减计数。 2.sysTick时钟源选择，通过位CLKSOURCE选择。 HAL库配置的时钟源是内核…

相关阅读 静态时序分析https://blog.csdn.net/weixin_45791458/category_12567571.html?spm1001.2014.3001.5482 目录 指定延迟值 指定端口、引脚列表 指定参考时钟 简单使用 指定时钟下降沿 指定参考端口、引脚 包含源、网络延迟 指定电平敏感 指定上升、下降沿 指…

一、点亮LED&#xff1a; 首先包含头文件 <REGX52.H> 随后令P2为0xFE。(此时二进制对应1111 1110&#xff0c;为0 的LED亮&#xff0c;故八个灯中的最后一个亮起)。 注&#xff1a;P2为控制LED的8位寄存器。 void main() {P2 0xFE;//1111 1110while(1){} } 二、L…

一、简介 1.嵌入式实时操作系统&#xff08;RTOS&#xff09; 嵌入式实时操作系统&#xff08;RTOS&#xff09;是专门设计用于嵌入式系统的操作系统&#xff0c;其主要特点是能够提供实时性能和确定性。RTOS通常用于处理对时间敏感的任务和需要快速响应的应用程序&#xff0c…

allegro高速信号添加PIN_delay的详细步骤 【下载地址】allegro高速信号添加PIN_delay的详细步骤分享 allegro高速信号添加PIN_delay的详细步骤本文档专门针对Allegro PCB设计软件用户&#xff0c;特别是那些在处理高速PCB设计时&#xff0c;需要对PIN延迟进行精确管理的工程师们…

一、修改两个任务的优先级 任务一 任务二 二、使用HAL_Delay的实验结果 结果&#xff1a; LED1亮&#xff0c;LED2不亮 三、使用osDelay的实验结果 结果&#xff1a; LED1亮&#xff0c;LED2亮 四、解释原因 vTaskDelay 与 HAL_Delay 的区别 1.vTaskDelay 作用是让任务阻…

文章目录 前言一、input delay二、output delay总结 前言 STA并不能去检查一条没有被约束的路径&#xff0c;不同的路径需要使用不同的约束。set_input/output_delay是关于IO边界上的约束。 set_input_delay 和set_output_delay都是对外部的延时信息的描述。 一、input dela…

参考&#xff1a;https://blog.csdn.net/zhanghaijun2013/article/details/104105740 发起端/发起寄存器/发起时钟/发起沿&#xff1a;指的是产生数据的源端 接收端/接收寄存器/捕获时钟/捕获沿&#xff1a;指的是接收数据的目的端 时序分析的最终目的是要分析出目的寄存器的时…

问题产生 我在学习中断的过程中，使用EXTI15外部中断，在其中加入HAL_Delay();就会发生报错 错误地方 其它地方配置 问题原因 在中断服务例程（ISR）中使用 HAL_Delay() 会导致问题的原因是： 阻塞性： HAL_Delay() 是一个阻塞函数，它通过不断地轮询系统时钟来实现延迟。在…

目录 1、遇到问题 2、问题解决 1、遇到问题 .\Objects\BH-F103.axf: Error: L6218E: Undefined symbol EXIT_Key_Config (referred from main.o). 2、问题解决 未将 .c源文件 放入工程中。

set_input_delay属于时序约束中的IO约束&#xff0c;我之前的时序约束教程中&#xff0c;有一篇关于set_input_delay的文章&#xff0c;但里面写的并不是很详细&#xff0c;今天我们就来详细分析一下&#xff0c;这个约束应该如何使用。 FPGA时序约束理论篇之IO约束 首先还是需…

GLS仿真与sdf反标注意事项 不同企业会涉及PS,PL仿真&#xff0c;或者只有PL仿真&#xff0c;或者只称之为后仿post-simulation。其中&#xff0c;将后仿真分为PS,PL大多指的是&#xff0c;PS-只带cell dealy的GLS(gate level simulation)&#xff0c;PL-还带net wire delay的G…

这篇文章确实带有一定的门槛&#xff0c;和我们平时的OOP编程不同&#xff0c;这种支持是编译时的&#xff0c;也就是说我们要抛弃传统OOP的思维&#xff0c;改为面向编译器进行编程。 我说的也不太清楚…重在自我理解&#xff0c;能找到这篇文章说明已经翻遍了CSDN…我也不会讲…

章节 后仿中做ZD仿真的目的后端插入的clk_gating单元对于ZD后仿的影响解决的方法 后仿中做ZD仿真的目的 ZD相比于SDF仿真具有仿真速度快的优点&#xff0c;在进行SDF仿真前&#xff0c;通过运行ZD仿真可以发现验证环境及一些验证case不完善的地方&#xff0c;例如MEM库单元使用…